1、最近我學(xué)習(xí)PCB的設(shè)計(jì)，對(duì)高速多層PCB來(lái)說，電源線、地線和信號(hào)線的線寬設(shè)置為多少是合適的，常用設(shè)置是怎樣的，能舉例說明嗎？例如工作頻率在300Mhz的時(shí)候該怎么設(shè)置？

答：300MHz的信號(hào)一定要做阻抗仿真計(jì)算出線寬和線和地的距離；電源線需要根據(jù)電流的大小決定線寬；地在混合信號(hào)PCB時(shí)候一般就不用“線”了，而是用整個(gè)平面，這樣才能保證回路電阻最小，并且信號(hào)線下面有一個(gè)完整的平面。

2、高速PCB，布線過程中過孔的避讓如何處理，有什么好的建議？

答：高速PCB，最好少打過孔，通過增加信號(hào)層來(lái)解決需要增加過孔的需求。

3、高頻信號(hào)布線時(shí)要注意哪些問題？

答：1）信號(hào)線的阻抗匹配；2）與其他信號(hào)線的空間隔離；3）對(duì)于數(shù)字高頻信號(hào)，差分線效果會(huì)更好。

4、差分線一般都需要等長(zhǎng)，如果實(shí)在在LAYOUT中有困難實(shí)現(xiàn)，是否有其他補(bǔ)救措施？

答：可以通過走蛇形線來(lái)解決等長(zhǎng)的問題，現(xiàn)在大多數(shù)的PCB軟件都可以自動(dòng)走等長(zhǎng)線，很方便。

5、何時(shí)要考慮線的等長(zhǎng)？如果要考慮使用等長(zhǎng)線的話，兩根信號(hào)線之間的長(zhǎng)度之差最大不能超過多少？如何計(jì)算？

答：差分線計(jì)算思路：如果你傳一個(gè)正弦信號(hào)，你的長(zhǎng)度差等于它傳輸波長(zhǎng)的一半是，相位差就是180度，這時(shí)兩個(gè)信號(hào)就完全抵消了。所以這時(shí)的長(zhǎng)度差是最大值。以此類推，信號(hào)線差值一定要小于這個(gè)值。

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6、高速中的蛇形走線，適合在那種情況？有什么缺點(diǎn)沒，比如對(duì)于差分走線，又要求兩組信號(hào)是正交的？

答：蛇形走線，因?yàn)閼?yīng)用場(chǎng)合不同而具不同的作用：

（1）如果蛇形走線在計(jì)算機(jī)板中出現(xiàn)，其主要起到一個(gè)濾波電感和阻抗匹配的作用，提高電路的抗干擾能力。計(jì)算機(jī)主機(jī)板中的蛇形走線，主要用在一些時(shí)鐘信號(hào)中，如PCI-Clk,AGPCIK,IDE,DIMM等信號(hào)線。

（2）若在一般普通PCB板中，除了具有濾波電感的作用外，還可作為收音機(jī)天線的電感線圈等等。如2.4G的對(duì)講機(jī)中就用作電感。

（3）對(duì)一些信號(hào)布線長(zhǎng)度要求必須嚴(yán)格等長(zhǎng)，高速數(shù)字PCB板的等線長(zhǎng)是為了使各信號(hào)的延遲差保持在一個(gè)范圍內(nèi)，保證系統(tǒng)在同一周期內(nèi)讀取的數(shù)據(jù)的有效性（延遲差超過一個(gè)時(shí)鐘周期時(shí)會(huì)錯(cuò)讀下一周期的數(shù)據(jù)）。

（4）蛇形走線在某些特殊的電路中起到一個(gè)分布參數(shù)的LC濾波器的作用。

7、電路中有高速邏輯器件時(shí)，最大布線長(zhǎng)度為多大？

答：布線不怕長(zhǎng)，就怕不對(duì)稱或者有比較大的差，這樣容易因?yàn)闀r(shí)延造成錯(cuò)誤的邏輯。

8、如何避免布線時(shí)引入的噪聲？

答：數(shù)字地與模擬地要單點(diǎn)接地，否則數(shù)字地回流會(huì)流過模擬地對(duì)模擬電路造成干擾。

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